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系統識別號 U0002-2606200611384600
DOI 10.6846/TKU.2006.00821
論文名稱(中文) 設計車庫倒車停車系統之模糊邏輯控制晶片
論文名稱(英文) Design of the Fuzzy Logic Control Chip for Garage Parking Systems
第三語言論文名稱
校院名稱 淡江大學
系所名稱(中文) 電機工程學系碩士班
系所名稱(英文) Department of Electrical and Computer Engineering
外國學位學校名稱
外國學位學院名稱
外國學位研究所名稱
學年度 94
學期 2
出版年 95
研究生(中文) 蘇膺中
研究生(英文) Ying-Chung Su
學號 693380239
學位類別 碩士
語言別 繁體中文
第二語言別
口試日期 2006-06-21
論文頁數 71頁
口試委員 指導教授 - 蕭瑛東
委員 - 黃培華
委員 - 劉志文
委員 - 陳昭榮
委員 - 周至如
委員 - 蕭瑛東
關鍵字(中) 模糊邏輯
停車系統
關鍵字(英) Garage Parking Control
Fuzzy Logic
第三語言關鍵字
學科別分類
中文摘要
本論文研究目的在於設計一自動倒車入庫之控制晶片。首先利用MATLAB模擬軟體對車體行駛行為進行模擬,模擬環境則設定車輛行走於具有牆面之道路與停車庫之環境下。車輛行駛過程中,在車輛靠牆邊的前後輪端設置感測器,量測車輛與牆面之間的距離,再將此所量測之類比訊號利用類比轉數位轉換器(A/D converter)轉成數位訊號作為控制晶片之輸入資料。此控制晶片之設計以模糊邏輯理論為基礎,將輸入訊號進行模糊化、與解模糊化運算,求得輸出訊號以控制車輛下一時刻的輸出轉角之大小。所設計之倒車入庫程序經過軟體模擬驗證無誤後以FPGA方式實現之,其中利用ALTERA公司推出之Quartus II軟體,對各個區塊之電路模組進行硬體描述語言(VHDL)之編寫,並進行輸入輸出之波形模擬驗證。最後完成的晶片功能將包含對輸入訊號模糊化、解模糊化、判斷是否抵達車庫位置、等倒車之功能。
英文摘要
The purpose of this thesis is to design and implement a FPGA chip for garage parking. Firstly, this study utilizes MATLAB to simulate and test the schema of garage parking. It assumes that the garage is walled. In other words, the parking process is to drive the car along the wall for backing into the garage. The side near to the wall of the car is installed distance sensors near the front and rear wheel. The analog signals of the detecting distance between the car and wall is transferred to digital signals by the analog to digital converter as the input signal of the FPGA chip. The control schema of the garage parking is the fuzzy theory and implemented by the Quartus II issued by the ALTERA based on the hardware description language. Finally, the function verification is performed to confirm the availability of the control chip.
第三語言摘要
論文目次
中文摘要  	I
英文摘要		II
誌謝	         III
目錄	         IV
圖索引	         VII
表索引	         X

第一章	緒論	1
	1.1研究動機與目的	1
	1.2研究步驟與方法	1
	1.3論文內容概述	2
第二章	模糊系統	3
	2.1簡介	3
	2.2模糊集合	3
	2.3歸屬函數	5
	2.4模糊系統之架構	8
		2.4.1模糊化機構	8
		2.4.2模糊規則庫	9
		2.4.3模糊推論引擎	10
		2.4.4解模糊化機構	12
第三章	倒車系統描述與分析	15
3.1系統數學模型	15
	3.2倒車入庫機制	18
		3.2.1前進狀態模糊控制機制	20
		3.2.2後退狀態模糊控制機制	25
	3.3車庫停車系統設計	27
	3.4倒車入庫系統控制器模擬結果	29
第四章	硬體電路設計與模擬結果	35
	4.1數位電路設計	35
	4.2數位電路設計流程	36
	4.3硬體描述語言與設計	39
		4.3.1VHDL介紹	39
		4.3.2模組化設計	42
		4.3.3階層式設計	42
	4.4晶片系統設計軟體與設計流程	44
	4.5各區塊硬體電路模組設計	         45
		4.5.1模糊化控制電路	46
		4.5.2決策邏輯電路	         49
			4.5.2.1取小電路	49
			4.5.2.2知識庫電路	50
		4.5.3解模糊化控制電路	52
			4.5.3.1二進位乘法器電路設計	53
			4.5.3.2除法器電路設計	54
		4.5.4脈衝寬度調變電路設計	58
	4.6硬體電路模擬結果     59
第五章	結論與未來展望	      67
5.1結論	                        67
	5.2未來展望	      67
參考文獻		               69


圖目錄

圖2.1  三角形歸屬函數	5
圖2.2  梯形歸屬函數	6
圖2.3  高斯函數歸屬函數	6
圖2.4  s函數歸屬函數	7
圖2.5  π函數歸屬函數	7
圖2.6  模糊系統基本架構	8
圖2.7  Simplified Fuzzy-Singleton法運算流程	12
圖3.1  模型車動態模型圖	15
圖3.2  車身與車庫相對位置俯視圖	18
圖3.3  模糊控制器架構示意圖	19
圖3.4  車體與牆相對示意圖	20
圖3.5(a)  模糊輸入變數 	23
圖3.5(b)  模糊輸入變數 	23
圖3.5(c)  模糊輸出變數 	24
圖3.6  車庫倒車流程圖	27
圖3.7(a)  倒車示意圖-車庫左側起始	28
圖3.7(b)  倒車示意圖-車庫右側起始	28
圖3.8(a)  車體位於車庫左側倒車模擬圖
[起始位置(xr,yr)=(600,1100),起始角度θ=0o]	31
圖3.8(b)  車體位於車庫左側倒車模擬圖
[起始位置(xr,yr)=(600,950),起始角度θ=0o]	31
圖3.8(c)  車體位於車庫左側倒車模擬圖
[起始位置(xr,yr)=(600,1100),起始角度θ=20o]	32
圖3.8(d)  車體位於車庫左側倒車模擬圖
[起始位置(xr,yr)=(600,1100),起始角度θ=-20o]	32
圖3.9(a)  車體位於車庫右側倒車模擬圖
[起始位置(xr,yr)=(3000,1100),起始角度θ=0o]	33
圖3.9(b)  車體位於車庫右側倒車模擬圖
[起始位置(xr,yr)=(3000,950),起始角度θ=0o]	33
圖3.9(c)  車體位於車庫右側倒車模擬圖
[起始位置(xr,yr)=(3000,1100),起始角度θ=20o]	34
圖3.9(d)  車體位於車庫右側倒車模擬圖
[起始位置(xr,yr)=(3000,1100),起始角度θ=-20o]	34
圖4.1  數位電路設計流程圖	37
圖4.2  VHDL 程式語言的設計靈活性說明圖	40
圖4.3  不同VHDL描述風格設計一個二位元比較器	41
圖4.4  VHDL階層式的設計架構示意圖	43
圖4.5  Quartus II使用介面	44
圖4.6  Quartus II的硬體開發流程圖	45
圖4.7  模糊晶片電路架構圖	45
圖4.8  模糊化電路示意圖	46
圖4.9  歸屬函數狀態與函數值範例	47
圖4.10 模糊化歸屬函數示意圖	48
圖4.11 決策邏輯電路示意圖	49
圖4.12 知識庫電路設計架構圖	51
圖4.13 解模糊化電路圖	52
圖4.14 乘法器示意圖	53
圖4.15(a) 運算控制電路	55
圖4.15(b) 商數運算電路	55
圖4.15(c) 餘數運算電路	56
圖4.16 脈衝寬度調變電路方塊圖	59
圖4.17 模糊化電路波形圖	60
圖4.18 取小電路波形圖	61
圖4.19 知識庫電路波型圖	61
圖4.20 決策電路波形圖	62
圖4.21 乘法電路波形圖	63
圖4.22 除法電路波形圖	64
圖4.23 解模糊化電路波形圖	65
圖4.24 脈衝寬度調變電路模擬圖	66


表目錄

表3.1  前進模糊輸入、輸出變數之轉角控制定義表	22
表3.2  車體前進轉角控制之決策推論邏輯規則表	25
表3.3  後退模糊輸入、輸出變數之轉角控制定義表	26
表3.4  車體前進轉角控制之決策推論邏輯規則表	26
表3.5  車庫與車體規格	30
表4.1  除法器運算電路步驟	56
表4.2  模糊化電路輸入輸出規格	60
表4.3  取小電路輸入輸出規格表	61
表4.4  知識庫電路輸入輸出規格表	61
表4.5  決策電路輸入輸出規格表	62
表4.6  乘法電路輸入輸出規格表	63
表4.7  除法電路輸入輸出規格表	64
表4.8  解模糊化電路輸入輸出規格表	65
表4.9  脈衝寬度調變電路輸入輸出腳規格	66
參考文獻
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