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系統識別號 U0002-2107201612125700
DOI 10.6846/TKU.2016.00664
論文名稱(中文) 應用於穿戴式或植入式生醫裝置之可變傳輸速率QPSK發射器
論文名稱(英文) A Multi-Rate QPSK Transmitter for Wearable or Implantable Biomedical Devices
第三語言論文名稱
校院名稱 淡江大學
系所名稱(中文) 電機工程學系碩士班
系所名稱(英文) Department of Electrical and Computer Engineering
外國學位學校名稱
外國學位學院名稱
外國學位研究所名稱
學年度 104
學期 2
出版年 105
研究生(中文) 楊珮婷
研究生(英文) Pei-Ting Yang
學號 604450048
學位類別 碩士
語言別 繁體中文
第二語言別
口試日期 2016-06-24
論文頁數 54頁
口試委員 指導教授 - 施鴻源
委員 - 饒建奇
委員 - 柯鈞琳
委員 - 施鴻源
關鍵字(中) 超低功耗
鎖相迴路
QPSK調變
關鍵字(英) Ultra Low-Power
PLL
QPSK
Modulation
第三語言關鍵字
學科別分類
中文摘要
目前生醫電子感測電路主要分為穿戴式和植入式,生醫電子使用的感測電路大部分須要使用數年之久,故其中的放大晶片需要採用超低功耗設計才能保持整體電路的續航力同時也可大大降低晶片的發熱量。
目前應用於超低功耗無線傳輸接收解調晶片之調變方式有以下三種,從最早期的振幅鍵移調變(Amplitude Shift Keying, ASK)到最近被廣泛使用的頻率鍵移調變(Frequency Shift Keying, FSK)及本篇論文使用的相位偏移調變(Phase Shift Keying, PSK)。ASK將資料放在載波頻率之振幅上,藉由接收到之訊號振幅大小來解調回傳輸端之輸出資料。FSK則是將訊號分為不同頻率,經由接收電路解調還原傳輸端之資料。而PSK是一種利用相位差異的訊號來傳送資料的調變方式。抗雜訊能力是三種調變中最佳的,在傳送過程中即使嚴重失真,在解調時仍可盡量避免錯誤的判斷。
QPSK(Quadrature Phase-shift Keying)相較於PSK系列中最簡單的BPSK(Binary Phase-shift Keying),QPSK在系統帶寬不變的情況下可以增大一倍數據傳輸速率或者在BPSK數據傳輸速率不變的情況下將所需帶寬減半。本架構是使用四個相位各差90°的訊號表示邏輯”00”、邏輯”01”、邏輯”10”及邏輯”11”的資料。它分別位在平面座標軸的X軸和Y軸上。這種系統在PSK系列中抗雜訊能力(SNR)是最佳的,在傳送過程中即使嚴重失真,在解調時仍可盡量避免錯誤的判斷。
本架構之QPSK發射器主要是由鎖相迴路、除頻器、相位選擇器所組成,鎖相迴路鎖住一穩定頻率,經過除頻器提供四個相位各相差九十度的訊號,等同於平面座標軸的四個相位,X軸和Y軸再分別經過相位選擇器選擇正向或反向訊號,便能產生位於零度、九十度、一百八十度及兩百七十度的訊號發射出去。
本論文的發射電路輸入參考訊號為8MHz、輸出的四個相位皆為64MHz,總功耗為3.66mW。在不同傳輸速率之間皆可正常運作,每bit在最差情況下2 Mb/s時會消耗1.83 nJ,但在16 Mb/s則只會消耗0.21 nJ。
英文摘要
Recently, wearable and implantable biomedical electronic devices are required urgently by biomedical applications. Biomedical information transmission between the devices can be achieved by wireless techniques. For extending life time of the devices, an ultra-low power and reliable wireless transmission interface is required.
In this thesis, an ultra-low power (ULP), multi-rate, human body communication (HBC), quadrature phase-shift keying (QPSK) transmitter applied for wearable or implantable biomedical devices is proposed. Instead of adopting amplitude shift keying (ASK) modulation, QPSK modulation has better immunity against interferers and higher data rate as the same frequency bandwidth is used. But QPSK modulation usually leads to a higher hardware complexity and power consumption. In this thesis, a ultra-low power and low hardware complexity QPSK transmitter is proposed. The transmitter transmits QPSK modulated data at a carrier frequency of 64 MHz.
As applied for wearable or implantable biomedical electronic devices, the transmitter consumes 3.66 mW under a minimum data rate of 2 Mb/s as designing in UMC 0.18 um CMOS process. The maximum energy consumption per transmitted bit is 1.83 nJ/bit. But under a maximum data rate of 16 Mb/s, the minimum energy consumption per transmitted bit is only 0.21 nJ/bit.
第三語言摘要
論文目次
目錄
致謝 II
中文摘要 III
英文摘要 IV
目錄 V
圖目錄 VII
表目錄 X
第一章 序論 1
1.1 研究背景 1
1.2 研究動機 2
1.3 論文架構 3
第二章 超低功耗發射器電路 4
2.1 發射器電路之類別與介紹 4
2.2 相位鍵移調變發射器之類別與介紹 10
第三章 超低功耗電路設計 14
3.1 超低功耗類比電路設計 14
3.2 超低功耗數位邏輯電路設計 17
第四章 電路設計 22
4.1 鎖相迴路 24
4.2 除頻器 34
4.3 相位選擇器 36
4.4 電路模擬結果 37
4.5 電路佈局 43
第五章 晶片量測 44
5.1 量測方式 44
5.2 量測結果 45
第六章 結論與未來展望 51
參考文獻 52
 
圖目錄

圖1.1 人體示意圖 2
圖2.1 OOK高效能收發晶片電路架構 5
圖2.2 OOK發射器電路架構 5
圖2.3 低功耗注入式鎖定接收發射電路架構圖 7
圖2.4 發射器調變電路架構圖 7
圖2.5 發射器電路架構 8
圖2.6 二階相位鍵移調變發射器之架構圖 11
圖2.7 四階相位鍵移調變發射器之架構圖 12
圖3.1 電晶體之I_D-V_GS特性曲線圖 15
圖3.2 以Pseudo-NMOS為主架構之四個輸入的NOR電路 18
圖3.3 數位電路輸出為”1”之概念等效 19
圖3.4 數位電路輸出為”0”之概念等效圖 20
圖4.1 二位元相位偏移調變發射電路架構圖 22
圖4.2 座標軸示意圖 23
圖4.3 鎖相迴路電路架構 24
圖4.4 相位偵測電路特性曲線圖 26
圖4.5 (a)相位偵測電路架構圖;(b) D型正反器電路圖 27
圖4.6 (a)訊號A相位領先B;(b)訊號B相位領先A 28
圖4.7 充電泵電路圖 30
圖4.8 (a)充電泵充電時;(b)充電泵放電時 31
圖4.9 震盪器的線性模型 32
圖4.10 環形震盪器之電路架構圖 33
圖4.11 除八除頻器之電路架構圖 34
圖4.12 數位除二除三電路之電路架構圖 35
圖4.13相位選擇器之電路架構圖 36
圖4.14 數據多工器之電路架構圖 37
圖4.15 鎖相迴路之模擬結果 pre-simulation 37
圖4.16 鎖相迴路Vc之穩定電壓 pre-simulation 38
圖4.17 CP輸出電壓之最大及最小值 pre-simulation 38
圖4.18 壓控環型振盪器之Phase Noise pre-simulation 39
圖4.19 環形震盪器pre-simulation以及post-simulation之頻率差異 39
圖4.20 相位選擇器之相對應輸出圖 pre-simulation 40
圖4.21 整體QPSK架構之模擬圖 post-simulation 41
圖4.22 電路佈局圖 43
圖4.23 電路佈局相對位置圖 43
圖5.1 量測方式示意圖 44
圖5.2 鎖相迴路I & IB之輸出結果 45
圖5.3 鎖相迴路I & Q之輸出結果 45
圖5.4 鎖相迴路Q & QB之輸出結果 46
圖5.5 鎖相迴路之RMS jitter 46
圖5.6 鎖相迴路之消耗電流 47
圖5.7 相位選擇器之消耗電流 47
圖5.8 能源效益與資料傳輸速率統計圖 48
圖5.9 晶片微影圖 48
圖5.10 PCB照相 49
圖5.11 實際量測發射狀況 49
 
表目錄

表2.1 ASK, FSK及PSK文獻比較表 9
表2.2 BPSK及QPSK文獻比較表 13
表4.1 系統參數 25
表4.2 鎖相迴路之參數表 25
表4.3 電路預計規格表 41
表4.4 文獻比較表 42
表5.1 量測結果 50
參考文獻
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